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ATSENSE301HA-AUR
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ATSENSE-101/ATSENSE-201(H)/ATSENSE-301(H) [DATASHEET]
11219B–ATSENSE–20-Feb-14
Figure 1-3. ATSENSE-101 Functional Block Diagram
ΣΔ ADC
PGA
ADCI0
<23:0>
IP0
IN0
DIFF
MUX
2:1
ΣΔ ADC
PGA
ΣΔ ADC
IP1
IN1
MCLK
Interrupt
Controller
ITOUT
VP1
VDDA
GNDA
VREF
VDDA
GNDA
VREF
VTEMP
VTEMP
ADC_CLK
(MCLK/2)
Control
Registers
Voltage
Reference
Die
Temperature
sensor
VDDIO
GNDD
Power
On Reset
Clock
Generator
FS_CLK
(MCLK/OSR)
ROM
(Calibration Data)
VREF
2.8V
LDO
VDDIN
VDDA
GNDA
Decimator
SPCK
NPCS
MISO
MOSI
Serial
Peripheral
Interface
ADCI1
<23:0>
ADCV1
<23:0>
Decimator
Decimator
VN
GNDREF
ATSENSE-101
VDDT
VDDA
GNDA
VREF
500Ω

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Microchip(微芯)
模拟前端 – AFE LQFP Green
Microchip(微芯)
模拟前端 – AFE ROOT PARTSLQFP GRN MRL A
Microchip(微芯)
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