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NCP1251FSN65T1G
0.35
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  • 引脚图在P1P2
  • 典型应用电路图在P1P2
  • 封装尺寸在P24
  • 焊盘布局在P24
  • 型号编码规则在P1P2P24
  • 标记信息在P1P2P24
  • 封装信息在P2
  • 技术参数、封装参数在P2
  • 应用领域在P1
  • 电气规格在P5P6
  • 型号编号列表在P4
NCP1251FSN65T1G数据手册
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NCP1251
www.onsemi.com
3
Figure 2. Internal Circuit Architecture
S
R
Q
Q
65 kHz
100 kHz
clock
vdd
Frequency
modulation
Vcc
Drv
Vcc logic
management
and fault timer
vdd
power
on reset
Rramp
LEB
vdd
RFB
/ 4.2
IpFlag
4 ms
SS
Power on
reset
IpFlag
GND
CS
FB
600−ns time
constant
OPP
Frequency
foldback
Vskip
Vlatch
The soft−start is activated during:
− the startup sequence
− the auto−recovery burst mode
+
Vlimit
VOPP
Vlimit + VOPP
Vfold
S
R
Q
Q
Clamp
20us time
constant
VOVP
1−us
blanking
Up counter
4
RST
OVP
gone?
VFB < 1.05 V ? setpoint = 250 mV
250 mV
peak current
freeze
UVLO
BO
Rlimit
Iscr

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